An 8.8-ns 54×54-bit multiplier with high speed redundant binary architecture
Makino, H.; Nakase, Y.; Suzuki, H.; Morinaka, H.; Shinohara, H.; Mashiko, K.
- 作者Makino, H.; Nakase, Y.; Suzuki, H.; Morinaka, H.; Shinohara, H.; Mashiko, K.
- 卷第31卷
- 期第6期
- 文件大小1250.65KB
- 发表时间1996
- DOI10.1109/4.509863
- 页码773-783